Questa CDC identifica y resuelve los problemas de cruce del dominio del clock, garantizando diseños digitales fiables y escalables;
Gracias a un análisis estructural avanzado, Questa CDC detecta dominios de clock, sincronizadores y estructuras de bajo consumo, identificando problemas de temporización y metastabilidad desde las primeras fases del diseño FPGA. Con soluciones completas de verificación automatizada y debugging, simplifica el proceso de validación y se integra perfectamente en los flujos de trabajo existentes. Ideal para proyectos complejos a gran escala, garantiza una alta calidad y fiabilidad, además de una reducción significativa del riesgo de errores en producción.
¿Por qué elegir Questa CDC para la verificación avanzada y fiable de dominios de clock en proyectos digitales?
Análisis exhaustivo del cruce de dominios de clock
Questa CDC proporciona un análisis estructural en profundidad para identificar problemas de temporización, riesgos de metaestabilidad y violaciones de protocolo en dominios de clock asíncronos. De este modo se evitan problemas críticos de CDC que podrían ser ignorados por la simulación tradicional.
Verificación automatizada y escalable
Questa CDC automatiza el proceso de verificación de CDC y admite la escalabilidad a nivel de SoC para diseños de miles de millones de compuertas. Su enfoque jerárquico y sus algoritmos de alto rendimiento reducen el tiempo de configuración y proporcionan resultados más rápidos y precisos.
Conciencia de la intención de baja potencia
Questa CDC es compatible con los estándares Unified Power Format (UPF) para garantizar que los elementos de bajo consumo, como las celdas de aislamiento, las celdas de retención y el escalado dinámico de voltaje, se verifiquen correctamente. Esto ayuda a prevenir errores de CDC en diseños de bajo consumo.
Integración total y fácil configuración
Gracias a la integración directa de Questa y a sus mínimos requisitos de configuración, ofrece una productividad inmediata. Identifica automáticamente los dominios de clock y los sincronizadores, ofreciendo más de 50 estilos de sincronización predefinidos y soporte para sincronizadores personalizados.
Usando sólo su RTL (y restricciones SDC o archivos UPF de intención de potencia), las soluciones CDC de Questa generan y analizan automáticamente aserciones para prevenir problemas CDC que destruyen chips.
Los modelos de metaestabilidad pueden exportarse a Questa Simulation para su posterior análisis,
y todos los resultados pueden transmitirse a la base de datos de progreso de verificación de Questa a través de UCDB.
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Verificación automática del Clock Domain Crossing (CDC)
Questa CDC ofrece una verificación CDC completa y automatizada mediante la identificación de dominios de clock, sincronizadores y estructuras de bajo consumo a través del análisis estático. Garantiza que las señales que cruzan dominios de clock asíncronos se sincronicen correctamente, evitando la metaestabilidad y los errores de temporización.
Conocimiento de la intención de bajo consumo
Questa CDC admite archivos UPF (Unified Power Format) y garantiza que los elementos de diseño de bajo consumo, como las celdas de aislamiento y el escalado dinámico de voltaje, no introduzcan problemas relacionados con el CDC. Ayuda a verificar los cruces de dominio de potencia y garantiza la integridad de los circuitos de bajo consumo.
Análisis escalables y de alto rendimiento
Diseñado para la escalabilidad a nivel de SoC, este CDC puede manejar diseños con miles de millones de puertos. Su enfoque jerárquico y el uso eficiente de la memoria garantizan un alto rendimiento, lo que permite ampliar proyectos grandes y complejos manteniendo una gran precisión.
Completas herramientas de debug
Questa CDC ofrece una depuración potente e intuitiva con visualizaciones de patrones y formas de onda específicos de los CDC. De este modo los problemas con el CDC pueden identificarse fácilmente, utilizando GUI familiares y codificadas por colores, y garantizar que los diseñadores puedan resolver rápidamente los problemas relacionados con los cruces del clock.
Integración total con Questa Simulation
Questa CDC se integra directamente con las herramientas de simulación de Questa, incluida la tecnología patentada de inyección de metaestabilidad, lo que permite a los diseñadores probar la resistencia de sus diseños a los fallos del CDC en el mundo real. Ayuda a identificar fallos críticos que podrían no detectarse únicamente mediante el análisis estático.
Productividad inmediata y guía de reparación automática
Con una configuración mínima, Questa CDC identifica automáticamente los dominios de clock, las estructuras de sincronización y los posibles problemas de CDC. Proporciona una guía de reparación automática, permite elegir entre más de 50 estilos de sincronización y admite sincronizadores personalizados para proyectos propios.
"Questa CDC detecta y resuelve problemas de cruce de dominio de clock (CDC), lo que garantiza el funcionamiento y la sincronización adecuados en los diseños digitales".
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